SerDes 简单介绍

最新推荐文章于 2025-07-03 15:20:41 发布

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#单片机 #fpga开发 #嵌入式硬件

如果你是一个搞通信的开发工程师，不管是硬件的还是驱动的，对这个肯定是很熟悉了；如果你是搞汽车电子的，可能相对来说陌生一点，但是没关系，随着车上的信号速率越来越高，很快你就需要了解它了；如果是搞自动驾驶的硬件设计，然后你还不是很熟悉，那么这个东西越快了解越好。

一般来说Serdes相关的高速信号问题，都归类到信号完整性，但是传统的信号完整性的知识讲的又都是偏重电路设计，而我们今天要说的重点可能在发送和接收端的均衡技术，更偏重现在的应用。

一什么是SerDes

SERDES是英文SERializer(串行器)/DESerializer(解串器)的简称，为什么这个词能成为一个专门的称呼呢？这个要从硬件信号的发展来说。最开始的高速信号传输效率提升，一定是从在同样的时钟频率下，多加数据线的来实现的，这就是并行信号，比如以前的DDR（之所以说以前的，是因为DDR5已经在增加一些串行技术进去了），MII，GMII ，等；

系统同步和源同步

在SerDes流行之前,芯片之间的互联通过系统同步或者源同步的并行接口传输数据。

GMII接口

GMII 接口，8个发送数据，8个接收数据，125M时钟实现1G的信号传输。（实际上RGMII就是GMII的串行化，把串并转换做在了芯片内部）。

但是，随着信号传输的数据量和速率越来越高，并行信号受限数据和时钟信号skew ，时钟周期抖动，同步开关噪声等（测试过DDR信号的工程师应该不陌生），信号速率很难提升。DDR是个还在坚持的例外，了解的同学也可以知道DDR提升的艰辛。

后来技术发展出了CDR,能从数据中恢复出时钟，这就太方便了。SerDes在接收端集成了CDR(Clock Data Recovery)电路，利用CDR从数据的边沿信息中抽取时钟，并找到最优的采样位置。SerDes不传送时钟信号，这也是SerDes最特别的地方，SerDes采用差分方式传送数据。

SerDes 接口

相比源同步接口，SerDes的主要特点包括:

1 在数据线中时钟内嵌,不需要传送时钟信号。

2 通过加重/均衡技术可以实现高速长距离传输，如背板。

3 使用了较少的芯片引脚.

很多接触Serdes的工程师，都会被各种加重/均衡技术搞晕，哪些是发送端的，哪些是接收端的，如何实现的？

二 SerDes 技术框图

典型的SerDes模块

从上面的图中我们可以看到，信号在芯片内部经过一个并转串，然后是FFE 均衡器，Driver 发送出去，接收端有DFE,CDR 串转并。两个问题来了，没接触过的会问，这些都是什么意思？接触过的问，预加重呢？没关系，我们分为发送端和接收端，分别来说。

三发送端均衡技术

由于串行信号速率太高，必须有信号均衡Equalizer技术来保证信号完整性。

FFE（Feed Forward Equalization前向反馈均衡）

发送侧均衡器设计为一个高通滤波器(HPF), 目标是让到达接收端的信号为一个干净的信号，这就是FFE。FFE的实现方式有很多，一个典型的例子如图：

三阶FFE

其实FFE 是一个比较偏数学或者说是频域的概念，具体到电路层次，从时域信号来看，一般又叫加重器(emphasis)。加重分为去加重(de-emphasis)和预加重(pre-emphasis)。De-emphasis 降低差分信号的摆幅(swing)。Pre-emphasis增加差分信号的摆幅。、由于目前芯片都需要追求降低功耗，所以大部分使用de-emphasis的方式，加重越强，信号的平均幅度会越小。

预加重

去加重

如果你用过博通的芯片，那么这部分可能会叫做：pre cursor/ post cursor，而且新的技术会有很多阶，通过各种调，你才能调出一个符合规范要求的眼图。

发送端均衡器也就是说FFE的大概效果是什么样子呢？前面说过，频域上讲，FFE相当于一个高通滤波器，调节滤波器的系数可以改变滤波器的频响，以补偿不同的信道特性，一般可以动态配置。以10Gbps线速率为例，图为FFE频率响应演示。可以看到，对于C0=0,C1=1.0,C2=-0.25的配置，5GHz处高频增益比低频区域高出4dB，从而补偿信道对高频频谱的衰减（高频衰减大）。（习惯看示波器的同学，边沿的上升就是对高频的增益加大，去加重和预加重的效果相同，只是信号摆幅一个小一个大）