Xilinx_ROM_IP核的使用

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于 2021-03-19 15:45:51 首次发布
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Xilinx_ROM_IP核的使用

说明：coe文件的制作，ROM文件的读取。
环境：Vivado2018.3。
IP核：Block Memory Generator。
参考手册：
UG473： 7 Series FPGAs Memory Resources
PG058 ：Block Memory Generator v8.4。
需要软件：
Guagle_wave
UltraEdit

文章目录

1.coe文件的制作(可制作指定波形)

1.打开Guagle_wave软件
在这里插入图片描述
2. 菜单栏–>查看–>全局参数设定
可以设置数据长度和数据位宽。
在这里插入图片描述

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3.3 Xilinx FPGA应用进阶通用IP核详解和设计开发-ROM核生成实例详解
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总之，coe文件与MIF文件只是格式上的区别，仿真中只使用MIF文件，原先导入数据的coe文件不再发挥作用。方法1的优势在于操作更加规范准确，方法2的操作虽然省去了构建IP核的时间消耗，但并没有从根本上修改coe文件，一旦用户重新配置IP核参数，旧coe文件仍然会生成旧的MIF文件。ROM核的生成演示以简单单端口ROM为例，并使用coe文件初始化ROM核内数据（coe文件的详细使用方法参见3.3.2节），coe文件中存储的数据为正弦信号，一个正弦周期包括1024次均匀采样点数据。
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《Xilinx系列FPGA芯片IP核详解》完整版。550页PDF格式。刘东华。FPGA的IP 核详解书籍。。FIFO使用，
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