AXI4协议

AXI4是ARM AMBA协议的一部分,适用于高性能存储器映射需求。它包括AXI4-Full、AXI4-Lite和AXI4-Stream三种类型,分别针对不同场景。AXI4-Lite简化了AXI4接口,不支持突发传输,适合低吞吐率通信。AXI协议提供了多种传输通道,如写地址、写数据、写响应、读地址和读数据通道,通过VALID/READY握手机制确保数据传输的同步。AXI4-Lite适用于简单的控制寄存器读写操作,而AXI4-Full则支持更复杂的存储器映射和突发传输。

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  • AXI
    AXI 高级可扩展接口,是ARM AMBA的一部分
    AMBA:高级微控制器总线架构: 开放的片内互联总线标准,能在多主机设计中实现多个控制器和外围设备之间的连接和管理。
  • AXI三种类型
    AXI4(AXI4-Full): 高性能的存储器映射需求;存储器映射:主机在对从机进行读写操作时,指定一个目标地址,这个地址对应系统存储空间的地址,表示对该空间进行读写操作————由于读写地址通道是分离的,所以支持双向传输,突发长度256
    **AXI4-Lite:**简化版的AXI4接口,用于低吞吐率存储器映射通信————和AXI4比较类似,但是不支持突发传输
    **AXI4-Stream(ST)😗*用于高速的流数据通信————只有一个单一数据通道,和AXI4的写数据通道类似,突发长度不受限制
  • AXI 优点
    生产力
    灵活性:AXI4(支持突发256) 和AXI4-Lite(1个数据) 都属于存储器映射
    可获得性
  • AXI传输通道
    写地址通道
    写数据通道
    写响应通道
    读地址通道
    读数据通道

AXI InterConnnect 和AXI SmartConnect 这两个IP核都用于连接单、多个存储器映射的AXI Master和单/多个存储器映射的

  • AXI的通道定义
    每一个独立的通道都包含一组信息信号、VALID信号和READY信号,用于提供双向的握手机制

信息源端使用VAILD信号表示地址,数据,和控制信息什么时候有效,
目的端通过使用READY信号表示什么时候可以接收信息
读数据通道和写数据通道都包含一个LAST信号,用于表示传输的最后一个数据

读数据通道和写数据通道都包含各自的地址通道,地址通道携带了请求所需的地址和控制信息

读数据通道由从机发送给主机,包含了读数据和读响应信息,读响应的信号用于表示读传输是否完成

写数据通道由主机发送给从机,包含了写数据,通过WSTRB

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