PCIE调试笔记理解--link training succeed

最新推荐文章于 2025-05-08 14:26:14 发布
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本文详细记录了PCIe链路训练的过程，强调在物理条件和CPU驱动正常时，正确配置IP核的时钟和复位是确保Link Training Succeed成功的关键。以EP4CGX50器件为例，介绍了生成PCIe Hard Core的步骤，包括时钟频率、版本选择、地址空间分配等参数设置。此外，还提到了TLP数据包的最大容量和管脚绑定的电平参数类型。

摘要生成于 C知道 ，由 DeepSeek-R1 满血版支持， 前往体验 >

PCIE链路 training，主要是PCIE IPcore物理层自动进行的，用户能干预的地方很少。但是可以通过测试LTSSM这个状态机输出的状态判断 training succeed是否成功。假如板卡物理条件和CPU驱动正常条件下，只要配置好IPcore的时钟和复位， Link training succeed一般会成功(其他原因，能力有效还没有遇到)！！！

以EP4CGX50器件生成PCIE HARD core为例，记录调试过程：

1. 生成IP core

参考时钟 refclk=100MHz；应用层时钟Application clock=62.5MHz；PCI Express版本PCI Express version=1.1(这个版本是几代决定了IP最大速度，gen1.0=2.5GT/S：每个lane=2.5Gbps)；其他参数暂时不懂保持默认值

 

BAR0/BAR1选择12bits=4KBytes地址空间；BAR2选择12bits=4KBytes地址空间(该IPcore CDMA操作的地址空间主要是BAR2/3)；其他参数暂时不懂保持默认值

 

link common clock勾选代表参考时钟refclk是CPU输出的。如果不勾选可以不需要CPU输出参考时

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