Quartus 联合 ModelSim 仿真 IP 核(RAM)

最新推荐文章于 2025-05-20 23:02:29 发布
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#verilog #ModelSim #模拟

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本文主要介绍如何在包含 IP 核的 Quartus 项目中使用 Modelsim 进行仿真，本文基于 IP 核 RAM: 2-PORT，其他 IP 核类似。

ModelSim 路径设置

点击 Tools->Options

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点击 EDA Tool Options，设置好 ModelSim 的路径，需要注意的是，路径一定要以 / 结尾，否则无法正确进行仿真（比如 D:/Programs/ModelSim/win64 就是错误的写法）。

如果使用 Questa Intel FPGA 来仿真，也一定要检查对应的路径是否是 / 结尾

请添加图片描述

创建 RAM

打开 IP Catalog，双击 RAM: 2-PORT

请添加图片描述

首先设置好 IP variation 的路径，接下来会进入 IP 核配置界面。

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开发环境：quartus prime pro 20；
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