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Xilinx XC7Z020双核ARM-FPGA开发板+AD9767芯片DDS信号发生器实验例程Verilog源码Vivado工...

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DDS信号发生器

0 下载量 66 浏览量 2022-12-24 16:23:13 上传评论收藏 240KB RAR 举报

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Xilinx XC7Z020双核ARM_FPGA开发板+AD9767芯片DDS信号发生器实验例程Verilog源码Vivado工程文件，可供学习设计参考。

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Xilinx XC7Z020双核ARM_FPGA开发板+AD9767芯片DDS信号发生器实验例程Verilog源码Vivado工程文件.rar （29个子文件）

说明.txt 149B

DDS_AD9767.srcs

sim_1

imports

DDS_AD9767.srcs

DDS_Module_tb.v 1004B

DDS_AD9767_tb.v 587B

new

constrs_1

new

DDS_AD9767.xdc 5KB

sources_1

imports

DDS_AD9767

sine_wave.coe 33KB

square_wave.coe 28KB

triangular_wave.coe 33KB

new

DDS_Module.v 1KB

DDS_AD9767.v 8KB

rom_triangular

rom_triangular.xml 207KB

rom_triangular.xci 39KB

rom_sine

rom_sine.xml 207KB

rom_sine.xci 39KB

vio_0

vio_0.xml 1.23MB

vio_0.xci 104KB

MMCM

MMCM.xci 94KB

MMCM.xml 273KB

ila_0

ila_0.xci 401KB

ila_0.xml 4.48MB

rom_square

rom_square.xci 39KB

rom_square.xml 207KB

DDS_Module_tb.v 1004B

DDS_AD9767_tb.v 2KB

bit

DDS_AD9767.bit 3.86MB

DDS_AD9767.ltx 12KB

sine_wave.coe 33KB

DDS_AD9767.xpr 23KB

square_wave.coe 28KB

triangular_wave.coe 33KB

共 29 条

为了缩短仿真时长，设计中通过条件编译设定了在板级验证和仿真时各个控制信号的初始值。用户在使用时，根据自己的需求，选择是否屏蔽条件编译语句`define sim

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