本文详细介绍了DDR内存的工作原理，包括其32位数据总线如何连接到CPU的DMC，4个设备的片选特性，以及内存bank的组织方式。每个设备由8个bank并联组成，每次操作只能读取一个bank。读取32位数据时，4个device的相同bank会同时被选中。地址线、控制线和数据线在所有device间共用，确保同时操作。此外，还提到了相关控制信号和特定引脚的功能，如DQS、DM、CKE等。
Memory的四个device的IO是并排在一起的，组成32位的数据总线，连接到CPU的DMC（动态内存控制器）
Memory的4个片选是接在一起的，即一次，四个chip全部被选中
128M x 8 I/Os 是由芯片选型决定的。
一个device由8个bank组成，与前面的RANK不同，这8个bank是并联在一起的.而不是并排（由Device构成的Bank是并排在一起的，一次性操作32位）。
一个device 8位数据宽度，每个bank的总线宽度都是8位，它们是通过总线并联在一起的。即在一个device对应的8个bank中，每次只能读取一个bank。
每个device，8块bank。
假设要读取0x00这个地址，由于总线宽度32位，4个device 并排，都是8位。要操作0x00这个地址，一读，一次性操作4个字节。 0x00数据在device 1的bank0， 0x01的数据在device 2的bank0，0x02的数据在device 3的bank0，0x03的数据在device 4的bank0，0x04的数据在device 1的bank1，0x05的数据在device 2的bank1，0x06的数据在device 3的bank1...
每次要取32位整数的时候，必定是4个device同时选通，每个device同时只有一个bank在工作。
读地址0x00的时候，位于device 1的0x00，device2的0x01，device3的0x02，device4的0x03同时被选中，4个地址/每个地址8字节，同时读出来
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